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2 páginas
2014/2015Laboratório 2 de
Electrónica II
Engenharia Mecatrónica
Docentes:
Maria João Costa
Fernando Janeiro
Trabalho elaborado por:
- André Fialho, nº 25101
-Luís Carapinha, nº32613
1.1)
Tabela de Verdade
A
B
C
D
XYZ
0
0
0
0
000
0
0
0
1
001
0
0
1
0
010
0
0
1
1
011
0
1
0
0
001
0
1
0
1
010
0
1
1
0
011
0
1
1
1
100
1
0
0
0
010
1
0
0
1
011
1
0
1
0
100
1
0
1
1
101
1
1
0
0
011
1
1
0
1
100
1
1
1
0
101
1
1
1
1
110
1.2)
Mapas de Karnaugh:
𝐹𝑥 = 𝐴𝐶 + 𝐴𝐵𝐷 + 𝐵𝐶𝐷
CD
AB
00
01
11
10
00
0
0
0
0
01
0
0
1
0
11
0
1
1
1
10
0
0
1
1
𝐹𝑦 = 𝐴𝐵𝐶 + 𝐴𝐶𝐷 + 𝐴𝐶 𝐷 + 𝐴𝐵𝐶 + 𝐴𝐵𝐶 𝐷 + 𝐴𝐵𝐶𝐷
CD
AB
00
01
11
10
00
0
0
1
1
01
0
1
0
1
11
1
0
1
0
10
1
1
0
0
𝐹𝑧 = 𝐵𝐷 + 𝐵𝐷
CD
AB
00
01
11
10
00
0
1
1
0
01
1
0
0
1
11
1
0
0
1
10
0
1
1
0
1.3)
Funções implementadas apenas com portas NAND
𝐹𝑥 = 𝐴𝐶 + 𝐴𝐵𝐷 + 𝐵𝐶𝐷 = 𝐴𝐶 + 𝐴𝐵𝐷 + 𝐵𝐶𝐷
= 𝐴𝐶 . 𝐴𝐵𝐷. 𝐵𝐶𝐷
𝐹𝑦 = 𝐴𝐵𝐶 + 𝐴𝐶𝐷 + 𝐴𝐶 𝐷 + 𝐴𝐵𝐶 + 𝐴𝐵𝐶 𝐷 + 𝐴𝐵𝐶𝐷
= 𝐴𝐵𝐶 . 𝐴𝐶𝐷 . 𝐴𝐶 𝐷. 𝐴𝐵𝐶 . 𝐴𝐵𝐶 𝐷. 𝐴𝐵𝐶𝐷
𝐹𝑧 = 𝐵𝐷 + 𝐵𝐷 = 𝐵𝐷. 𝐵𝐷
1.4)
Esquema do circuito que implementa a função de 1.2)
Esquema do circuito que implementa a função de 1.3)
2.3)
Pior tempo de propagação tpLH [ns] tpHL[ns]
NOT
AND
2in
AND
4in
OR
2in
15
15
18
18
15
20
15
15
Para a função de 1.2), o valor de pior tempo de propagação será {tpLH (NOT) + tpHL (AND 4in) + 5x tpLH (OR 2in)}, sendo 15+20+5x15=110 ns.
tpLH [ns] tpHL [ns]
NAND
2in
NAND
3in
NAND
4in
NAND
8in
15
15
15
15
15
15
18
20
Para a função de 1.3), o valor de pior tempo de propagação será {tpLH (NAND
2in) + tpLH (NAND 4in) + tpLH (NAND 8in)}, sendo 15+15+20=50 ns.